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Cypress Semiconductor CYDC128B16 Manual de usuario Pagina 24

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CYDC128B16
Document #: 001-01638 Rev. *H Page 24 of 29
Figure 14. Interrupt Timing Diagrams
Notes
25. t
HA
depends on which enable pin (CE
L
or R/W
L
) is deasserted first.
26. t
INS
or t
INR
depends on which enable pin (CE
L
or R/W
L
) is asserted last.
Switching Waveforms (continued)
WRITE 1FFF (OR 1/3FFF)
t
WC
Right Side Clears INT
R
:
t
HA
READ 1FFF
t
RC
t
INR
WRITE 1FFE (OR 1/3FFE)
t
WC
Right Side Sets INT
L
:
Left Side Sets INT
R
:
Left Side Clears INT
L
:
READ 1FFE
t
INR
t
RC
ADDRESS
R
CE
L
R/W
L
INT
L
OE
L
ADDRESS
R
R/W
R
CE
R
INT
L
ADDRESS
R
CE
R
R/W
R
INT
R
OE
R
ADDRESS
L
R/W
L
CE
L
INT
R
t
INS
t
HA
t
INS
(OR 1/3FFF)
OR 1/3FFE)
[25]
[26]
[26]
[26]
[25]
[26]
[+] Feedback
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